나노종합기술원, 반도체 소부장 국산화 지원 박차

대전=박희윤 기자 입력 2022. 5. 30. 08:53
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나노종합기술원은 반도체 소부장 지원역량 강화를 위한 12인치 반도체 20나노 미세패턴 공정기술 개발에 성공했다고 30일 밝혔다.

국내 최초로 12인치 반도체 테스트베드를 구축 운영하고 있는 나노인프라 기관인 기술원은 핵심장비(ArF Immersion Scanner 등)와 클린룸 구축을 완료하고 2021년 3월부터 국내외 반도체 소부장 기업을 위한 서비스를 제공하고 있는 중으로 소부장 기업은 대기업 반도체 양산기술 수준에 부합하는 반도체 소재와 장비 개발을 위한 20나노급 미세패턴과 증착 서비스 제공을 요청해왔다.

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12인치 반도체 20나노 미세패턴 공정기술 개발 성공
12인치 반도체 테스트베드 활용 반도체 소부장 국산화 지원역량 강화 ?
나노종합기술원 2층 청정실에 설치된_12인치 나노반도체 테스트베드. 사진제공=나노종합기술원
[서울경제]

나노종합기술원은 반도체 소부장 지원역량 강화를 위한 12인치 반도체 20나노 미세패턴 공정기술 개발에 성공했다고 30일 밝혔다.

국내 최초로 12인치 반도체 테스트베드를 구축 운영하고 있는 나노인프라 기관인 기술원은 핵심장비(ArF Immersion Scanner 등)와 클린룸 구축을 완료하고 2021년 3월부터 국내외 반도체 소부장 기업을 위한 서비스를 제공하고 있는 중으로 소부장 기업은 대기업 반도체 양산기술 수준에 부합하는 반도체 소재와 장비 개발을 위한 20나노급 미세패턴과 증착 서비스 제공을 요청해왔다.

이에 기술원은 공정별 전문가로 구성된 TF을 구성해 공정기술 개발을 추진한 결과, 6개월이라는 단기간에 추가적 장비투자 없이 20나노 미세패턴 공정기술을 개발하는 데 성공했다.

기술원이 개발한 공정기술은 노광, 식각, 박막 등 기구축 장비를 활용한 공정기술 개발과 집적화를 통한 기술개발 성과다. 12인치 핵심장비(ArF Immersion Scanner)의 40나노 노광공정과 식각공정 등을 기반으로 SADP(Self-Aligned Double Patterning) 기술을 개발해 20나노 미세패턴을 구현하는 데 성공했다.

SADP(Self-Aligned Double Patterning·자기 정렬 이중 패터닝)는 반도체 집적도를 높이기 위한 패턴 구현기술로 식각공정과 박막 공정 등을 활용, 노광장비에서 구현할 수 있는 패턴의 최소크기 대비 절반 이하 크기로 줄이는 공정기술이다.

특히 개발된 공정기술은 추가적인 장비투자없이 기술원이 보유한 12인치 반도체 장비만을 통하여 구현된 기술로 예산절감(200억원 이상), 개발기간 단축과 집적도를 4배 높일 수 있는 공정기술을 확보했다는 데 큰 의의가 있다.

향후 기술원은 개발된 공정기술을 20나노 미세패턴을 활용할 국내 반도체 소재 기업과 장비기업의 서비스 수요에 활용하고 이를 통해 서비스 영역 확장을 추진할 계획이다.

이조원 나노종합기술원 원장은 “이번 공정기술 개발은 기술원의 12인치 반도체 테스트베드 활용도를 획기적으로 높일 수 있는 성과”라며 “향후 국내 반도체 대기업 및 소부장 기업과의 연계와 협력을 기반으로 반도체 강국 구현을 위한 공공 테스트베드의 역할과 책임을 더욱 강화해 나가겠다”고 밝혔다.

대전=박희윤 기자 hypark@sedaily.com

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